这个两个内存 哪个好？

内存延迟
内存延迟表示系统进入数据存取操作就绪状态前等待内存相应的时间，它通常用4个连着的阿拉伯数字来表示，例如“3-4-4-8”，一般而言四个数中越往后值越大，这4个数字越小，表示内存性能越好。由于没有比2-2-2-5更低的延迟，因此国际内存标准组织认为以现在的动态内存技术还无法实现0或者1的延迟。但也并非延迟越小内存性能越高，因为CL-TRP-TRCD-TRAS这四个数值是配合使用的，相互影响的程度非常大，并且也不是数值最大时其性能也最差，那么更加合理的配比参数很重要。
第一个数字最为重要，表示注册读取命令到第一个输出数据之间的延迟（CAS Latency），即CL值，单位是时钟周期。这是纵向地址脉冲的反应时间。
第二个数字表示从内存行地址到列地址的延迟时间（RAS to CAS Delay），即tRCD。
第三个数字表示内存行地址控制器预充电时间（RAS Precharge），即tRP。指内存从结束一个行访问到重新开始的间隔时间。
第四个数字表示内存行地址控制器激活时间Act-to-Precharge Precharge Delay（tRAS），
详解：
内存延迟时间有个专门的术语叫“Latency”。要形象的了解延迟，我们不妨把内存当成一个存储着数据的数组，或者一个EXCEL表格，要确定每个数据的位置，每个数据都是以行和列编排序号来标示，在确定了行、列序号之后该数据就唯一了。内存工作时，在要读取或写入某数据，内存控制芯片会先把数据的列地址传送过去，这个RAS信号（Row Address Strobe，行地址信号）就被激活，而在转化到行数据前，需要经过几个执行周期，然后接下来CAS信号（Column Address Strobe，列地址信号）被激活。在RAS信号和CAS信号之间的几个执行周期就是RAS-to-CAS延迟时间。在CAS信号被执行之后同样也需要几个执行周期。此执行周期在使用标准PC133的SDRAM大约是2到3个周期，而DDR RAM则是4到5个周期。在DDR中，真正的CAS延迟时间则是2到2.5个执行周期。RAS-to-CAS的时间则视技术而定，大约是5到7个周期，这也是延迟的基本因素。
CL设置较低的内存具备更高的优势，这可